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低應(yīng)變動(dòng)測(cè)技術(shù)之樁基工程中應(yīng)用美國(guó)PDI PIT-VV樁基完整性測(cè)試儀|埃登威自動(dòng)化系統(tǒng)設(shè)備(上海)有限公司

低應(yīng)變動(dòng)測(cè)技術(shù)之樁基工程中應(yīng)用美國(guó)PDI PIT-VV樁基完整性測(cè)試儀

 

隨著我國(guó)橋梁和高層建筑的發(fā)展,樁基礎(chǔ)工程作為一種常見(jiàn)的基礎(chǔ)形式,應(yīng)用越來(lái)越廣泛。目前國(guó)內(nèi)外普遍優(yōu)選應(yīng)力波反射法(錘擊波法)和聲波透射法。其中,低應(yīng)變完整性檢測(cè)方法因其測(cè)試快速、簡(jiǎn)單而應(yīng)用zui為廣泛。

 

目前,低應(yīng)變完整性檢測(cè)已被廣泛用于檢測(cè)混凝土橋梁基樁的完整性,并確定基樁是否存在缺陷、缺陷的程度和位置。經(jīng)過(guò)多年的發(fā)展,現(xiàn)已形成成熟的技術(shù)經(jīng)驗(yàn)。低應(yīng)變反射波法的基本原理是基于一維彈性桿平面應(yīng)力波的波動(dòng)理論。假定樁身為一維彈性桿(樁長(zhǎng)>直徑)。在樁頂?shù)腻N擊力作用下,產(chǎn)生壓縮波,壓縮波沿樁身向下傳播。當(dāng)樁身存在明顯的波阻抗Z變化界面時(shí),會(huì)產(chǎn)生反射波和透射波,反射波的相位和振幅由波阻抗Z變化決定。安裝在樁頂?shù)膫鞲衅鲿?huì)接收到從樁身波阻抗Z變化界面反射回來(lái)的信息,經(jīng)過(guò)放大、濾波、數(shù)據(jù)處理。根據(jù)這些信息,可以分析和判斷樁身的完整性。低應(yīng)變動(dòng)測(cè)技術(shù)之樁基工程中應(yīng)用美國(guó)PDI PIT-VV樁基完整性測(cè)試儀

 埃登威公司銷(xiāo)售的美國(guó)PDI PIT-VV 樁基完整性測(cè)試儀。該產(chǎn)品是樁基完整性測(cè)試儀現(xiàn)在賣(mài)的很好。如果您需要購(gòu)買(mǎi),請(qǐng)通過(guò)埃登威客服專(zhuān)線(xiàn)聯(lián)系我們!

 

PDI PIT-VV樁基完整性測(cè)試儀產(chǎn)品介紹:

PDI公司zui近根據(jù)中國(guó)市場(chǎng)的實(shí)際需求推出了新型樁基完整性測(cè)試儀

PIT-VV樁基完整性測(cè)試儀有兩個(gè)數(shù)據(jù)通道,可以支持兩個(gè)加速度傳感器進(jìn)行數(shù)據(jù)采集。當(dāng)連接頂置加速度傳感器時(shí),可以完成常規(guī)的單速測(cè)試;當(dāng)連接兩個(gè)側(cè)向加速度傳感器時(shí),可以實(shí)現(xiàn)雙速測(cè)試。當(dāng)連接內(nèi)置傳感器(**加速度通道)的錘子時(shí),可以測(cè)試瞬態(tài)響應(yīng)方法。

標(biāo)準(zhǔn)PIT-VV包括兩個(gè)頂置加速度傳感器??蛻?hù)可根據(jù)實(shí)際需要選擇側(cè)面加速度傳感器、內(nèi)置傳感器的錘子、加速度傳感器延長(zhǎng)線(xiàn)。雙速測(cè)試采用安裝在樁側(cè)面的兩個(gè)側(cè)向加速度傳感器,通過(guò)測(cè)量?jī)蓷l速度曲線(xiàn)計(jì)算混凝土波速并提取上游波速曲線(xiàn),從而判斷樁的完整性。

低應(yīng)變動(dòng)測(cè)技術(shù)之樁基工程中應(yīng)用美國(guó)PDI PIT-VV樁基完整性測(cè)試儀

 PDI PIT-VV樁基完整性測(cè)試儀產(chǎn)品特點(diǎn):

或者下載坑的實(shí)測(cè)數(shù)據(jù)。

時(shí)域分析

并創(chuàng)建自定義列表輸出。

多格式輸出報(bào)告

支持將圖形復(fù)制或粘貼到其他應(yīng)用程序。

公制,公制和英制單位可用。

具有屏幕幫助功能

 

形狀參數(shù):

規(guī)格:75×170×235毫米

重量:2.2千克

顯示器:高對(duì)比度觸摸屏顯示器,適合在各種照明條件下使用。

溫度范圍:可在0 ~ 40℃下正常工作,可在-20 ~ 65℃下儲(chǔ)存

電源:內(nèi)置電源可連續(xù)使用8小時(shí)。

便攜式儀器箱

 

電子參數(shù): 低應(yīng)變動(dòng)測(cè)技術(shù)之樁基工程中應(yīng)用PIT-VV樁基完整性測(cè)試儀

 

內(nèi)置SA1110微處理器,工作頻率為204MHz。

使用PCMCIA存儲(chǔ)卡(128M)存儲(chǔ)數(shù)據(jù),存儲(chǔ)容量幾乎不受限制。

帶24位A/D轉(zhuǎn)換卡

頻率為22KHz(-3dB)

采樣頻率大于1MHz低應(yīng)變動(dòng)測(cè)技術(shù)之樁基工程中應(yīng)用美國(guó)PDI PIT-VV樁基完整性測(cè)試儀

采樣精度在0.01%以?xún)?nèi)

觸發(fā)電壓0.3伏

 

PDI PIT-VV樁基完整性測(cè)試儀功能參數(shù):

您可以輸入測(cè)試樁的詳細(xì)信息。

記錄測(cè)試日期和時(shí)間。

當(dāng)同時(shí)測(cè)量力和速度曲線(xiàn)時(shí),可以進(jìn)行曲線(xiàn)擬合。

測(cè)量數(shù)據(jù)的自動(dòng)存儲(chǔ)

可以使用一個(gè)或兩個(gè)加速度通道進(jìn)行數(shù)據(jù)采集,然后將加速度信號(hào)集成為速度信號(hào)。

具有早期信號(hào)增益和數(shù)字放大功能。

測(cè)量的信號(hào)可以通過(guò)存儲(chǔ)卡回放。

取樣錘擊次數(shù)可調(diào)。

能夠生成用于制作簡(jiǎn)單報(bào)表的數(shù)據(jù)位圖文件。

加速度傳感器(頂部或側(cè)面)

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